masatani の履歴(No.3)

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  • 1 (2012-04-19 (木) 16:06:38)
  • 2 (2012-04-19 (木) 16:07:14)
  • 3 (2012-05-08 (火) 22:50:01)
  • 4 (2012-05-09 (水) 08:19:58)
  • 5 (2012-07-09 (月) 11:39:56)
  • 6 (2012-07-27 (金) 18:44:26)

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5/8(火)†

phenitec†

12入力nandのためのパーツとして 3入力norと4入力nandを作成した。

このとき、nMOSを直列につなげる回路の部分で隣り合う別のゲートそれぞれのVTNEの間隔を0にするかルール通りにするか考えたが(どちらでもDRCは通った)、スペースに余裕が有ったので間隔をあけた。(図:VTNEの間隔)

#ref(): File not found: "VTNE間隔.png" at page "masatani"

目次

コメント†

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