12入力nandのためのパーツとして 3入力norと4入力nandを作成した。
このとき、nMOSを直列につなげる回路の部分で隣り合う別のゲートそれぞれのVTNEのどうするかするかルール通りにするか考えたが(どちらでもDRCは通った)、スペースに余裕が有ったので間隔をあけた。
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